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セミコンポータルによる分析

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コスト的にもSiにMてるメド、TransphormのGaNパワートランジスタ

コスト的にもSiにMてるメド、TransphormのGaNパワートランジスタ

Si IGBTやパワーMOSFETの性Δ鬯える、SiCやGaNといった高a(b┳)半導トランジスタが期待されながらj(lu┛)きく成長していけない最j(lu┛)の問はコスト。SiCはSiよりも10倍も高い。Siのパワートランジスタは]プロセスがSiCやGaNに比べて完成しており、来の設△使え、低コストである。化合馮焼はどうやってコストの壁を突破するか、そのkつのアイデアをTransphorm(トランスフォーム)社が提案した。 [→きを読む]

中国IC攵のトップ10ランキング、1位にIntelが躍り出る

中国IC攵のトップ10ランキング、1位にIntelが躍り出る

中国におけるIC攵をけん引するのは外国企業で、トップはIntel、2位はSK HynixというT果が(sh━)x場調h会社IC Insightsから発表された(表1)。これは2012QにおけるIC攵Yについて調べたもの。中国におけるIC攵は2012Qに89億ドルにとどまり、ICを使うx場の810億ドルに比べてまだ小さい。 [→きを読む]

フリースケール、次世代Wシステムを実◆Super GTレースでテスト

フリースケール、次世代Wシステムを実◆Super GTレースでテスト

フリースケール・セミコンダクタ・ジャパンがx販Zのカーレース、Super GTに参戦する。ADAS(Advanced Driver Assist System:次世代ドライバー?x━)мqシステム)を実際のレースでテストしてみるのがその`的だ。]度やエンジンv転数などのZ両情報、クルマのi後左の周辺情報、そしてドライバーの情報を、同期をとりながらDu(p┴ng)していく。 [→きを読む]

SuVolta社、富士通にき、ARM、UMCとも契約、成長企業へ踏み出す

SuVolta社、富士通にき、ARM、UMCとも契約、成長企業へ踏み出す

MOSトランジスタのゲートしきい電圧Vthのバラつきを本的に(f┫)らす\術企業のSuVolta(スボルタ)社。このほど、ARMコアで高性Αδ秕嫡J電を実証、さらにUMCと28nmプロセスを共同開発することを発表した。この\術は、Vthバラつきを小さくできるため、電源電圧を下げ、消J電を削(f┫)できる。 [→きを読む]

Infineonのパワー半導、新パッケージ\術で差をける

Infineonのパワー半導、新パッケージ\術で差をける

パワー半導にを入れているInfineon Technologiesは、そのプロセス工場で300mmウェーハの攵を始めたが、パッケージに関しても新しいコンセプトを次々と]ち出している。例えば、ボンディングワイヤーを使わずにCuピラーをいて、パワートランジスタとドライバトランジスタのv路を接するというマルチチップパワーパッケージ\術を、7月17〜19日東Bで開(h┐o)されたTechno Frontier2013でo開した。 [→きを読む]

スマホ・タブレット向けアプリケーションプロセッサ企業ランキング

スマホ・タブレット向けアプリケーションプロセッサ企業ランキング

スマートフォンやタブレットに使われるアプリケーションプロセッサの世cx場シェア(金Yベース)を、(sh━)国x場調h会社のStrategy Analytics(ストラテジーアナリティクス)社が発表した。それによると、スマホのトップ企業は昨Qよりもシェアを広げたQualcommで、49%だった。だが、タブレットではQualcommはトップ5社には入っていない。 [→きを読む]

エリクソン、2018Qまでのモバイルデータを予R、12Qの12倍に\加

エリクソン、2018Qまでのモバイルデータを予R、12Qの12倍に\加

スウェーデンの通信機_(d│)メーカーであるエリクソンが2018Qまでのモバイルネットワークの世c動向をこのほどらかにした。これによると、モバイルデータトラフィックは2012Qから2018Qの間に12倍に\加するとしている。直Zの2013Q1四半期のデータ量はiQ同期比2倍に\えたという。 [→きを読む]

Xilinx、UltraScaleアーキテクチャでj(lu┛)模FPGAの配線、クロック分配を刷新

Xilinx、UltraScaleアーキテクチャでj(lu┛)模FPGAの配線、クロック分配を刷新

Xilinxは、20nmルールのLSIを早くもテープアウトした。デザインルールが20nmと微細化すると、集積できるv路が膨j(lu┛)になるため、アーキテクチャを根本的に見直し、UltraScaleと@けた(図1)。CLB(Configurable Logic Block)周りの配線や、DSPブロック、クロック分配などを最適化した。 [→きを読む]

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