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GlobalFoundriesがデザインハウスを充実、めに転じる

ファウンドリビジネスを啣修垢襪燭瓠GlobalFoundriesは3カ月iにデザインハウスAvera Semiconductorを設立したが、このほどCadenceのEDAツールの採もめた。ファウンドリでは、]することだけではない。設ツールを揃え、あらゆる顧客に官することがその成功のカギとなる(図1)。トップのTSMCはデザインハウスを子会社にeっている。

図1 GlobalFoundriesがeつ12nmFINFETプロセスのツール 出Z:GlobalFoundries

図1 GlobalFoundriesがeつ12nmFINFETプロセスのツール 出Z:GlobalFoundries


日本でファウンドリビジネスが育たない背景のkつには、]\術さえあれば顧客はM}に来てくれると思い込んでいることがあった。これまでの日本のIDM(設から]も}Xける半導メーカー)は、O社ののラインが余っていて、かつ外雋覿箸らラインを使わせてもらえないか、という依頼をpけた時のみ个栄蕕Α△箸い辰薪騨余η笋鬚笋辰討た。これはビジネスではない。タバコ屋さんと同じである。相}が来てくれてなおかつ、こちらのラインが余っている時にす、というだけであり、本当の営業マンなりセールスマンがいなかった。これではビジネスがうまくいくはずがない。

湾のTSMCは、設ツールを揃えただけではなく、Global Unichipというデザインハウスを子会社にeっている。デザインハウスは、LSI設言語であるVHDLやVerilogを使ってシステム設の設フローをプログラムしてRTLフォーマットに出してくれる。さらにはv路の接情報を表すネットリストも作成し、中でフォーマリティ検証やバグのチェックなどを行い、配・配線のレイアウトを済ませ、最終的にマスクデータのフォーマットGDS IIなどの形でデータセットを仕屬欧討れる。このデータをマスクに焼きけるなり、あるいはTSMCなどのファウンドリにeっていく。

こういったLSI設のk連の流れを、アマゾンやグーグルなどのOTT(Over the top)が咾垢襪世蹐Δ?半導設出のRTLをuるために、今チップユーザーは半導設しか使われないVHDLなどの半導設言語を今さら咾靴覆てもよいのだ。デザインハウスに依頼すればBりる。だから半導設の素人であるグーグルやアマゾン、フェイスブックでさえ、O分仕様の半導チップを入}できるのである。

2018Qの11月にGlobalFoundriesがAvera Semiを設立したときは、SynopsysのIPであるDesignWave IPをGFのプロセスで]してきた実績がある、と述べている(参考@料1)。Synopsysは、設ツールベンダーであると同時に極めてHくのIPを揃えているIPベンダーでもある。CPUなどはArmのIPを提供する。

このほどCadenceは、Avera Semiに、カスタムICやデジタルv路、システム検証、PCB設・解析など広JなEDAソリューションを提供する。Avera Semiはこれらのツールを使い、12nm、14nmの複数のテープアウトを完了させ、顧客に向けのデザインを提供する。

このAvera Semiを率いるCEOは、GFのIBM MicroelectronicsA収により、そのASICビジネスのリーダーだったKevin O’Buckley。同はIBMで20Q以屐\術的・経営的なリーダーを経xしてきた。このため、同が率いてきたチームは2015QA収時からGFに所錣靴討い燭、半導設の経xは25Qにも及び、IBM時代からは2000以屬糧焼設を}Xけてきたという。

Avera Semiは7nmプロセス以Tの微細化設にも官する。ただし、GlobalFoundriesは、7nmプロセスを念したと伝えられており、Avera Semiが7nmプロセスのチップを設するとしてもファウンドリはTSMCかSamsungが}Xけることになるが、GFはこのことについてはコメントしていない。

参考@料
1. GLOBALFOUNDRIES Introduces Avera Semi, a Wholly Owned Subsidiary to Deliver Custom ASIC Solutions (2018/11/01)

(2019/02/18)
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