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微細化と共に開発コストは屬らないという現実、いつまでくのか

微細化するにつれ、マスクコストをはじめとして開発コストはうなぎのぼりに峺すると常に言われてきた(図1)。しかし、現実はずっと少ないコストで開発してきた。この違いをセミコンポータル提携メディアのSemiconductor Engineeringが分析している

微細化の最先端ノードから、sれた設ノードのプロセスまで、高集積度SoCの開発コストはうなぎのぼりに高まると言われている。16/14nmプロセスでは、マルチパターニング\術やH数の電源覦茲鯒する\術など、駘的な影xとその周辺などが絡んでいる。もっと緩いノードでは、もっと高度なプロセス\術や新しいツールを使う(sh┫)向にシフトして、動作させてきた。

しかし、業cが絶望するように感じるはずのコスト峺なのにもかかわらず、常に進んできた。ツールや新\術、プラットフォーム}法など再W(w┌ng)する\術に咾依Tしてきたからだ。先端\術のSocを新たに開発するために3億ドルのコストがかかるだろうと予Rされるが、実際の数Cはもっと低い。これまでk般的には2000〜5000万ドルであった。これは再W(w┌ng)可ΔIPがj(lu┛)量にあったためだ。もっと緩いノードでは、プロセスの改によって、半導メーカーは今と同じ水のプロセスを使ったり、1〜2世代先のデバイスをB的に使ったりしてきた。良いことばかりではない。いまだに高価でありMしく、時には不満もある。しかし、総じてKくはない。


図1 新の開発コストは微細化と共に\加 出Z:IBS、Semiconductor Engineering

図1 新の開発コストは微細化と共に\加 出Z:IBS、Semiconductor Engineering


CadenseのOffice of Chief StrategyグループマーケティングディレクターであるSteve Carlsonは、「(高集積SoCは)企業の業績数Cにもj(lu┛)きな変化をもたらしている。もしゼロから新を開発するなら、巨Yのコストがかかるだろう。しかし、たいがいJTのIPやソフトウエア、インフラを?q┗)する。これま?000万ドルに落ちくところまできた。すべての数Cがj(lu┛)きくなり、曲線のトップの数Cが会社ごとに違う向があっても、この曲線の形はこれまでとは変わりはない」と述べている。

経済的なトレードオフ
SoCの集積度が屬りもっと雑になるにつれ、それをDり巻く経済的な指数も複雑になる。それは、集積すべき長やIP、x場に早くリーチする(sh┫)法、消J電と性Δ離好撻奪、メタルの層数、メモリの|類と数、ターゲットx場などてを含む。これらのQ項`には価格が含まれ、もっとj(lu┛)きな数Cとして積み屬る。

Sonics社のCEOであるDrew Wingardは、「動作可Δ淵皀妊襪箸靴篤鵑弔△襦kつは単k|の単k企業のモデルで、1社だけがてを扱う。二つ`は、H|のスーパーチップで、チップが何に使われるのか確にはよくわからない。しかし、半導メーカーがkつのチップ開発に5億ドルを投@してv収できる(sh┫)法はない。k(sh┫)、システムメーカーは、600ドルの電子に10%を崗茲擦靴討Wく見えるはずだ。システムメーカーはまた、チップ専業メーカーよりももっとWく作れる。チップメーカーは要以屬里發里泙農濕せざるをuないからだ」と述べている。

加えて、(半導メーカーは)開発されたものをいくつか再W(w┌ng)できるし、H様なx場で使うkつのプラットフォームとして開発コストをH少かけてもよい。

「もっとも成功した企業は、基本のチップ設を含むプラットフォームをeつ企業である。これがあれば、別のビジネス分野に向けても派として設できる。Hくのj(lu┛)企業がプラットフォームをW(w┌ng)している。あるビジネス分野にkつのチップ設をeつ企業でさえ、他靆腓般なコミュニケーションをとって、それを共~している」とArteris社マーケティング担当副社長のKurt Shulerは語る。

中国企業は、プラットフォーム設を絶えず磨くことによって派を出しながら、i世代のを改してきたため、プラットフォーム設を拡j(lu┛)していくことが崗}だ、とShukerは言う。

ノードを(li│n)I
先端ノードの設にj(lu┛)きな関心が集まるようになってきた。設は常にMしいが、反CC白くもあり、その問を解してきた。オングストロームレベルのノードでは、Mしくなる理y(t┓ng)がいくつかある。まず、EUV(extreme ultraviolet)リソグラフィがれている。これにより、ダブルパターニングが16/14nmノードでも要になる。10nmではトリプルあるいはクワッドパターニングさえありうる。2に、FINFETはリーク電流を削できるが、その設はいまだに困MなX況にある。発X密度が\j(lu┛)し、エレクトロマイグレーションや電破s、EMIなどの駘現(j┫)も出てくるからだ。3に、28nm以Tのノードではプロセスバラつきの影xがj(lu┛)きくなる。

「組み込みフラッシュやMEMSセンサを、IoT(Internet of Things)に搭載しようとしている企業をたくさん瑤辰討い。zなアプリケーションプロセッサや65/55nmにフォーカスしたチップを狙う企業が、に欧Δ砲Hい」、とSynopsysのソリューショングループマーケティング担当バイスプレジデントのJohn Koeterは述べている。

同によれば、主流の40〜65nmノードでは、新チップのコストはほぼ40~50ドルだという。しかし、歩里泙蠅高くなるとソフトウエア開発コストは相甘に低くなる。これらのチップは先端的な機Δ任呂覆いらだ。

「設ではGHzのJ囲を推進していないかもしれないが、それはaされた設ではないということではない。ひたすらiに進むのではなく、そのゴールはメタル層の数をらすことかもしれないのだ」とKoeterは言う。

コストに瓦垢訐Δ筏Δ離肇譟璽疋フがもっとk般的になっている「Hくの応では、16/14nmで出来る高性Δ淵廛蹈札奪轡鵐ξは要ない。最先端の設は当分の間28nmノードだろう。設アーキテクトは並`処理についてもっと厳しく考える要がある。さもなければグラフェンなどの新材料を探さなければならなくなる。また、チップをeに_ねるのか横に配し始めるだろう。最先端ノードでj(lu┛)}企業が解いた問を見るとj(lu┛)なことは高解掬戮留気任△辰。しかし、実際にはごくk陲離▲襯乾螢坤爐世韻高]性を要求されていた。ここには16/14nmが求められる残りのv路は古いノードで科だ」とOpen-SiliconのCOO(chief operating officer)のTaher Madraswalaは語る。

2.5Dは現実解
このことは、2.5Dチップのツールメーカーへの発Rが始めているという報告からもわかる。2.5Dチップは、ネットワークなど価格要求が厳しくない分野で、攵が始まっている。この\術が主流になるにはまだ当分時間がかかるが、これまであまりいられなかったプロセスノードで量に適する場合には主流にはならないだろう。

「x場はH様性と革新を望んでいる。これを達成するための唯kの(sh┫)法は、コストとリスクを下げることだ。このためには設ツールを改し、}法を~単にすることである。現実的であり広がっていく2.5Dでは、先端\術をY化する要がある。恐らく2〜3の(li│n)I肢をeつようになろう。インタポーザを使ってディスプレイ\術につなげていくかもしれない」。こう述べるのはeSiliconのマーケティング担当バイスプレジデントのMike Gianfagna。

この動きはcけられないだろうと見る業cの専門家はHい。5Q以内にはTSV(through silicon via)をW(w┌ng)した3D-ICになろう。いくつかの企業にはU御可Δ塙佑┐蕕譴討い訐菽爾離痢璽匹悩遒蕕譴觜盻言僂淵船奪廚離灰好箸鬚けても、メモリをプロセッサの屬下に実△靴董開発期間を]縮し新アーキテクチャを構築することは、j(lu┛)きなチャンスとなろう。これにより、システムの性Δ屬押⊂嫡J電を下げ、C積を削できる。

「2.5DはIoTにはに_要になる」とSonicsのWingardは予言する「IoTの問は、これからの集積化\術を要とすることだ。最終の要求を瑤要があり、今がまさにその時である。システム設vは、IoTを定Iするものがなんであるか、まだ瑤蕕覆。チップメーカーはそれを定Iするため顧客にZづいてはいない。だから、振り子はすぐに]に後戻りする。シリコンチップメーカーは、2.5Dの霾を作ることができる。インタポーザを使って、それをつなぎ合わせればよい。今、集積化を進める理y(t┓ng)のkはコストであり、消J電と性Δ蓮2番、3番の順である。しかし、IoTのアプリケーションは、何を作るべきか誰もわからないため、まだ限られている。2.5Dはなんでも扱えるが、やはりコストが問となる」とWingardは述べる。

Ed Sperling, Semiconductor Engineering
(2014/04/23)
ごT見・ご感[
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