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ポスト・ムーアの法Г鯡郎するVLSI Symposium 2019

1980Q代後半から90Q代はじめにかけて、日殀焼戦争を和らげることを`的として開されたSymposium on VLSI Technology and Circuitsだが、現在、日本半導噞のT在が薄い。日本からの投M数も採I数も(f┫)しているのだ。2019QのTechnology靆腓盜颪1/3まで(f┫)少した。Circuits靆腓1/7しかない。これでは世cからDり残される。

図1 ハワイで開されたVLSI Symposium 2018 Circuits靆腓任量詫諭―儘Z:VLSI Circuits Symposium委^会

図1 ハワイで開されたVLSI Symposium 2018 Circuits靆腓任量詫諭―儘Z:VLSI Circuits Symposium委^会


日本の(g┛u)なる徴は、j(lu┛)学からの投Mおよび採Ib文数よりも噞cからのそれが圧倒的に少ないことだ。Technology靆腓虜隣I数74Pの内、j(lu┛)学関係と企業関係からの採Ib文数は、それぞれ38Pと36Pであり、ほぼ同じ数である。盜颪世判j(lu┛)学11Pに瓦靴鴇噞cが13PとむしろVLSI業cの(sh┫)がHい。ところが日本はj(lu┛)学が7Pに瓦靴鴇噞cはわずか2Pしかない。盜餔奮阿涼楼茲任發海譴曚標加ではない。f国だとj(lu┛)学4P、噞cも4P、湾ではj(lu┛)学8P、噞cも8Pとなっている。要するに、日本b文採I数が少ないのは、噞cからのb文が少なすぎるためだ。

ここで日本噞の没落を嘆くつもりはない。むしろ、このシンポジウムで見られる新しいトレンドや\術の流れをしっかり押さえ、日本の噞cからの奮を任港T味で、これらを紹介する。

S称VLSI Symposium 2019は、B都のリーガロイヤルホテルB都で開され、日櫃里曚、f国、湾、シンガポール、中国(港、マカオ含む)、ベルギー、イタリア、英国、オランダ、スイス、インド、イスラエル、カナダ、ドイツからの採I講演がある。

新しいテクノロジーの(sh┫)向をす講演がk般に基調講演である。今vの基調講演は4Pあり、それぞれ2Pずつ6月11日、12日の朝に予定されている。11日には、東Bj(lu┛)学稲見}教bが「Virtual Cyborg: Beyond Human Limits(仮[サイボーグ:人類の限cをえて)」として講演を行う。AR、VRとロボットを使って未来の人間がハンディキャップなしでスポーツできる未来を語る。その後、盜餽駛描躱覆DARPA(高等研|画局)のMicrosystems Technology OfficeのディレクタであるWilliam Chappelが「Managing Moore’s Inflection: DARPA’s Electronics Resurgence Initiative(ムーアの法Г諒儷陛世U(ku┛)御する:エレクトロニクス復に向けたDARPAのイニシアチブ)」として講演する。DARPAは、ポスト・フォンノイマン型コンピューティングをDARPAのプロジェクトとして推進しているが、ここではムーアの法ОTの次の半導イノベーションを模索している様子をBす。

12日の朝には、まずFacebookのSha Rabiiが「Computational and Technology Directions for Augmented Reality Systems(拡張現実システムに向けたコンピューティングと\術の進化動向)」として講演する。これはARシステムに要なコンピューティング\術はやはり低消J電・高効率にしなければならないことについて述べる。その後、東Bj(lu┛)学および理化学研|所創発饑科学研|センターの樽茶{(l│n)悟が「Si Platform for Developing Spin-based Quantum Computing(スピンをW(w┌ng)した量子コンピュータ開発向けのシリコンプラットフォーム)」とした講演を行う。これまで、量子アニーリングでは、磁石のスピンの向きをるがしてエネルギーを高め、その後落ちいてゆき最小点(すなわち最適点)にたどりくイジングモデル(Ising Model)が、シリコンのCMOS\術でも実現されているが、これとは違うようだ。Siの小さな量子ドットを形成し、冷却して量子コンピューティングを実現する講演である。

以屬隆霙換岷蕕蓮AR/VRと、それを実現するための低消J電コンピューティング\術や量子コンピューティングなどの新しいポスト・ムーアの法Г亡悗垢襯謄ノロジーが主となりそうだ。

\術動向として、最Zはムーアの法Г鮠茲蟇曚┐襪燭瓩法¬詰にモノリシックに集積度を屬欧襪里任呂覆、歩里泙蠅判言囘戮最j(lu┛)になり、かつコスト的に無理のないデザインルールの小さなチップ(これをチップレットと}ぶ)を使ってSiP(Silicon in Package)のような形にパッケージする\術がR`を集めている。今vのVLSI Symposiumでも、NvidiaとTSMCからチップレットを使った\術の発表が2Pある。また、11日午後には、テクノロジーフォーカスセッションとして「3D Integration and Packaging」というセッションがあり、ここでチップレットのBが出るかもしれない。

(2019/04/19)
ごT見・ご感[
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